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  1. # sh testcase for pdec
    2. 

  2. # mach: shdsp
    3. 

  3. # as(shdsp):	-defsym sim_cpu=1 -dsp 
    4. 

  4. 

  5. 	.include "testutils.inc"
    6. 

  6. 

  7. 	start
    8. 

  8. 

  9. pdecx:
    10. 

  10. 	set_grs_a5a5
    11. 

  11. 	lds	r0, a0
    12. 

  12. 	pcopy	a0, a1
    13. 

  13. 	lds	r0, x0
    14. 

  14. 	lds	r0, x1
    15. 

  15. 	lds	r0, y0
    16. 

  16. 	lds	r0, y1
    17. 

  17. 	pcopy	x0, m0
    18. 

  18. 	pcopy	y1, m1
    19. 

  19. 

  20. 	pdec	x0, y0
    21. 

  21. 	assert_sreg	0xa5a40000, y0
    22. 

  22. 

  23. 	test_grs_a5a5 
    24. 

  24. 	assert_sreg	0xa5a5a5a5, x0
    25. 

  25. 	assert_sreg	0xa5a5a5a5, x1
    26. 

  26. 	assert_sreg	0xa5a5a5a5, y1
    27. 

  27. 	assert_sreg	0xa5a5a5a5, a0
    28. 

  28. 	assert_sreg2	0xa5a5a5a5, a1
    29. 

  29. 	assert_sreg2	0xa5a5a5a5, m0
    30. 

  30. 	assert_sreg2	0xa5a5a5a5, m1
    31. 

  31. 

  32. pdecy:
    33. 

  33. 	set_grs_a5a5
    34. 

  34. 	lds	r0, a0
    35. 

  35. 	pcopy	a0, a1
    36. 

  36. 	lds	r0, x0
    37. 

  37. 	lds	r0, x1
    38. 

  38. 	lds	r0, y0
    39. 

  39. 	lds	r0, y1
    40. 

  40. 	pcopy	x0, m0
    41. 

  41. 	pcopy	y1, m1
    42. 

  42. 

  43. 	pdec	y0, x0
    44. 

  44. 	assert_sreg	0xa5a40000, x0
    45. 

  45. 

  46. 	test_grs_a5a5
    47. 

  47. 	assert_sreg	0xa5a5a5a5, y0
    48. 

  48. 	assert_sreg	0xa5a5a5a5, x1
    49. 

  49. 	assert_sreg	0xa5a5a5a5, y1
    50. 

  50. 	assert_sreg	0xa5a5a5a5, a0
    51. 

  51. 	assert_sreg2	0xa5a5a5a5, a1
    52. 

  52. 	assert_sreg2	0xa5a5a5a5, m0
    53. 

  53. 	assert_sreg2	0xa5a5a5a5, m1
    54. 

  54. 

  55. dct_pdecx:
    56. 

  56. 	set_grs_a5a5
    57. 

  57. 	lds	r0, a0
    58. 

  58. 	pcopy	a0, a1
    59. 

  59. 	lds	r0, x0
    60. 

  60. 	lds	r0, x1
    61. 

  61. 	lds	r0, y0
    62. 

  62. 	lds	r0, y1
    63. 

  63. 	pcopy	x0, m0
    64. 

  64. 	pcopy	y1, m1
    65. 

  65. 

  66. 	set_dcfalse
    67. 

  67. 	dct	pdec	x0, y0
    68. 

  68. 	assert_sreg	0xa5a5a5a5, y0
    69. 

  69. 	set_dctrue
    70. 

  70. 	dct	pdec	x0, y0
    71. 

  71. 	assert_sreg	0xa5a40000, y0
    72. 

  72. 

  73. 	test_grs_a5a5 
    74. 

  74. 	assert_sreg	0xa5a5a5a5, x0
    75. 

  75. 	assert_sreg	0xa5a5a5a5, x1
    76. 

  76. 	assert_sreg	0xa5a5a5a5, y1
    77. 

  77. 	assert_sreg	0xa5a5a5a5, a0
    78. 

  78. 	assert_sreg2	0xa5a5a5a5, a1
    79. 

  79. 	assert_sreg2	0xa5a5a5a5, m0
    80. 

  80. 	assert_sreg2	0xa5a5a5a5, m1
    81. 

  81. 

  82. dcf_pdecy:
    83. 

  83. 	set_grs_a5a5
    84. 

  84. 	lds	r0, a0
    85. 

  85. 	pcopy	a0, a1
    86. 

  86. 	lds	r0, x0
    87. 

  87. 	lds	r0, x1
    88. 

  88. 	lds	r0, y0
    89. 

  89. 	lds	r0, y1
    90. 

  90. 	pcopy	x0, m0
    91. 

  91. 	pcopy	y1, m1
    92. 

  92. 

  93. 	set_dctrue
    94. 

  94. 	dcf	pdec	y0, x0
    95. 

  95. 	assert_sreg	0xa5a5a5a5, x0
    96. 

  96. 	set_dcfalse
    97. 

  97. 	dcf	pdec	y0, x0
    98. 

  98. 	assert_sreg	0xa5a40000, x0
    99. 

  99. 

  100. 	test_grs_a5a5 
    101. 

  101. 	assert_sreg	0xa5a5a5a5, x1
    102. 

  102. 	assert_sreg	0xa5a5a5a5, y0
    103. 

  103. 	assert_sreg	0xa5a5a5a5, y1
    104. 

  104. 	assert_sreg	0xa5a5a5a5, a0
    105. 

  105. 	assert_sreg2	0xa5a5a5a5, a1
    106. 

  106. 	assert_sreg2	0xa5a5a5a5, m0
    107. 

  107. 	assert_sreg2	0xa5a5a5a5, m1
    108. 

  108. 

  109. 	pass
    110. 

  110. 	exit 0
    111.